[IEEE 2016 Joint International EUROSOI Workshop and International Conference on Ultimate Integration on Silicon (EUROSOI-ULIS) - Wien, Vienna, Austria (2016.1.25-2016.1.27)] 2016 Joint International EUROSOI Workshop and International Conference on Ultimate Integration on Silicon (EUROSOI-ULIS) - Impact of the design layout on threshold voltage in SiGe channel UTBB-FDSOI pMOSFET

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